"Pin Information for the Stratix® IV GX EP4SGX360 Device Version 1.5" Bank Number VREF Pin Name/Function Optional Function(s) Configuration Function Dedicated Tx/Rx Channel Emulated LVDS Output Channel F780 Note(2) "F1152 Notes(1), (3)" "F1152 Notes(1), (3) (with PMA Transceiver)" F1517 F1760 DQS for X4 for F780 DQS for X8/X9 for F780 DQS for X16/X18 for F780 DQS for X4 for F1152 DQS for X8/X9 for F1152 DQS for X16/X18 for F1152 DQS for X32/X36 for F1152 Note(4) DQS for X4 for F1152 (with PMA Transceiver) DQS for X8/X9 for F1152 (with PMA Transceiver) DQS for X16/X18 for F1152 (with PMA Transceiver) DQS for X32/X36 for F1152 (with PMA Transceiver) Note(4) DQS for X4 for F1517 DQS for X8/X9 for F1517 DQS for X16/ X18 for F1517 DQS for X32/ X36 for F1517 Note(4) DQS for X4 for F1760 DQS for X8/X9 for F1760 DQS for X16/ X18 for F1760 DQS for X32/ X36 for F1760 1A TDI TDI H23 G28 C29 J29 A38 1A TMS TMS J21 H28 A33 N27 B38 1A TRST TRST G24 K26 B34 A32 A41 1A TCK TCK F24 F29 B33 G30 A40 1A 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VCCIO8A C26 L25 C27 M26 J30 VCCIO8A H21 G24 C32 J28 F30 VCCIO8A F19 F28 F25 D30 F33 VCCIO8A C21 C28 K24 A30 C33 VCCIO8A C36 VCCIO8B D22 C24 K25 L26 VCCIO8B D25 K21 E26 J27 VCCIO8B F27 VCCIO8B C27 VCCIO8B C30 VCCIO8C C18 G21 A19 L22 J24 VCCIO8C H17 F18 F21 F22 F24 VCCIO8C E15 B19 K18 C23 C24 VCCPD1A N23 M25 U27 U29 VCCPD1C J22 R23 V22 W27 AB29 VCCPD2A AB26 AF29 VCCPD2C Y26 AD29 VCCPD3A W18 AC23 AB22 AD24 AH27 VCCPD3B AC21 AB20 AD22 AH24 VCCPD3C W16 AC19 AB18 AD20 AH22 VCCPD4A W10 AC13 AA13 AD14 AH16 VCCPD4B AC15 AB14 AD16 AH17 VCCPD4C W14 AC17 AB16 AD18 AH19 VCCPD5A AC13 AE14 VCCPD5C AA13 AB14 VCCPD6A P12 M10 U13 V14 VCCPD6C T12 U13 W13 AA14 VCCPD7A K11 M12 N13 R15 R16 VCCPD7B M14 N15 R17 R19 VCCPD7C K13 M16 N17 R19 R20 VCCPD8A K17 M22 P22 R25 R27 VCCPD8B M20 N21 R23 R25 VCCPD8C K15 M18 N19 R21 R23 1A VREFB1AN0 VREFB1AN0 VREFB1AN0 M26 N27 P28 R30 1C VREFB1CN0 VREFB1CN0 VREFB1CN0 K22 R26 V25 U29 W31 2A VREFB2AN0 VREFB2AN0 VREFB2AN0 AF28 AG30 2C VREFB2CN0 VREFB2CN0 VREFB2CN0 AB29 AC32 3A VREFB3AN0 VREFB3AN0 VREFB3AN0 AB19 AF26 AH26 AN28 AP29 3B VREFB3BN0 VREFB3BN0 VREFB3BN0 AF22 AH23 AL24 AM25 3C VREFB3CN0 VREFB3CN0 VREFB3CN0 AB16 AF20 AH20 AP22 AT22 4A VREFB4AN0 VREFB4AN0 VREFB4AN0 AB8 AF10 AH9 AN12 AR14 4B VREFB4BN0 VREFB4BN0 VREFB4BN0 AF13 AH12 AM16 AN18 4C VREFB4CN0 VREFB4CN0 VREFB4CN0 AA12 AF15 AH15 AL18 AM20 5A VREFB5AN0 VREFB5AN0 VREFB5AN0 AG11 AH12 5C VREFB5CN0 VREFB5CN0 VREFB5CN0 AD11 AE12 6A VREFB6AN0 VREFB6AN0 VREFB6AN0 M10 N8 P11 R12 6C VREFB6CN0 VREFB6CN0 VREFB6CN0 R10 V10 U11 W12 7A VREFB7AN0 VREFB7AN0 VREFB7AN0 G7 J10 G9 G12 H14 7B VREFB7BN0 VREFB7BN0 VREFB7BN0 J13 G12 H16 K18 7C VREFB7CN0 VREFB7CN0 VREFB7CN0 G13 J15 G15 E20 G20 8A VREFB8AN0 VREFB8AN0 VREFB8AN0 G20 J26 G26 F29 G30 8B VREFB8BN0 VREFB8BN0 VREFB8BN0 J22 G23 H25 M26 8C VREFB8CN0 VREFB8CN0 VREFB8CN0 G17 J20 G20 J21 L23 NC D24 D31 C30 L28 A39 NC T21 AK28 AN34 AM28 BA37 NC R19 AK7 AF9 AK11 BB5 NC AB24 G7 B2 F11 B3 NC AC5 AL29 AJ32 AV36 AY40 NC P9 AL30 AJ31 AU35 BA40 NC F5 AL5 AJ4 AU5 BA3 NC AE25 AL6 AJ3 AV4 AY3 NC AE26 AJ7 AA11 AD17 AM31 NC AE3 AJ28 AA12 R16 AM32 NC AE4 AH7 AA23 R26 AK13 NC U19 AH28 AA24 AG15 NC T8 AG7 AB11 AC29 NC T9 AG28 AB24 AB30 NC T19 AF7 R11 R14 NC T20 AF28 R12 G10 NC R9 AE7 R13 NC P10 AE28 R23 NC N10 AD7 R24 NC AD28 T12 NC AC7 T22 NC AC28 T23 NC Y12 NC Y23 VCCAUX E24 H27 F28 H29 J34 VCCAUX AC24 AF27 AH27 AL28 AU34 VCCAUX AD5 AG8 AH8 AL12 AP10 VCCAUX E5 J8 F7 G11 H10 VCCA_L N23 V29 U30 M35 AF38 VCCA_L R23 Y29 AC30 AF35 T38 VCCA_R R6 V6 U5 M5 AF5 VCCA_R N6 Y6 AC5 AF5 T5 VCCH_GXBL0 V24 AA28 Y29 AE34 AE38 VCCH_GXBL1 L23 U28 R29 AA34 AA38 VCCH_GXBL2 U34 W38 VCCH_GXBR0 V5 AA7 Y6 AE6 AE5 VCCH_GXBR1 L6 U7 R6 AA6 AA5 VCCH_GXBR2 U6 W5 VCCL_GXBL0 W23 Y27 Y28 AD33 AE37 VCCL_GXBL0 Y24 AA26 W28 AE33 AD37 VCCL_GXBL1 K24 V27 R28 Y33 AA37 VCCL_GXBL1 J23 W28 P28 AA33 AB37 VCCL_GXBL2 T33 V37 VCCL_GXBL2 U33 W37 VCCL_GXBR0 Y5 AA9 Y7 AD7 AE6 VCCL_GXBR0 W6 Y8 W7 AE7 AD6 VCCL_GXBR1 K5 V8 R7 Y7 AB6 VCCL_GXBR1 J6 W7 P7 AA7 AA6 VCCL_GXBR2 T7 W6 VCCL_GXBR2 U7 V6 VCCR_R M5 U5 W5 T5 U7 VCCR_R U6 AA5 N5 Y5 AG7 VCCR_R AD5 VCCR_L U23 U30 W30 T35 AG36 VCCR_L M24 AA30 N30 Y35 U36 VCCR_L AD35 VCCT_R P5 AB6 R5 P5 U5 VCCT_R T5 W5 AA5 V5 AC5 VCCT_R AB5 Y5 VCCT_L T24 W30 R30 P35 U38 VCCT_L P24 AB29 AA30 V35 AC38 VCCT_L AB35 Y38 VCCHIP_R P7 W9 Y9 W9 AA9 VCCHIP_R R7 Y10 W9 Y9 AB9 VCCHIP_R N7 Y9 V9 AA9 Y9 VCCHIP_L N22 W26 Y26 W31 AA34 VCCHIP_L R22 Y26 W26 Y31 AB34 VCCHIP_L P22 Y25 V26 AA31 Y34 RREF_L0 AF28 AN34 AK34 AW38 BA42 RREF_L1 D28 D34 A34 C42 RREF_R0 AF1 AN1 AK1 AW2 BA1 RREF_R1 D1 D1 A6 C1 Notes: "1. EP4SGX110, EP4SGX180, EP4SGX230, EP4SGX290, and EP4SGX360 devices have two variants in the F1152 package option—one with no PMA-only transceiver channels (Transceiver Count of ordering code: F) and the other with eight PMA-only transceiver channels (Transceiver Count of ordering code: H)." 2. Dual purpose configuration pin (Pin with *) in F780 of EP4SGX360 and EP4SGX290 can only be used as configuration pin. These pins cannot be used as regular I/O. 3. Stratix IV GX devices without PMA transceiver channels do not have vertical migration to or from devices with PMA transceiver channels. "4. Altera's external memory interface IPs do not support placement of the BWSn pins outside the DQS/DQ group adjacent to the x32/x36 DQS/DQ groups where the write data pins reside. When using x32/x36 DQS/DQ groups that have 40 pins, BWSn inputs are not supported. However, if you are not using Altera's memory interface IPs and you are using x32/x36 DQS/DQ groups that have 40 pins, you can place the BWSn pins in a separate ×4 DQS/DQ group adjacent to the x32/x36 DQS/DQ group where the write data pins reside." "Pin Information for the Stratix® IV GX EP4SGX360 Device Version 1.5" Bank Number VREF Pin Name/Function Optional Function(s) Configuration Function Dedicated Tx/Rx Channel Emulated LVDS Output Channel F1932 DQS for X4 for F1932 DQS for X8/X9 for F1932 DQS for X16/ X18 for F1932 DQS for X32/ X36 for F1932 1A TDI TDI A36 1A TMS TMS B36 1A TRST TRST F36 1A TCK TCK G35 1A TDO TDO E36 1A VREFB1AN0 PLL_L1_CLKn PLL_L1_CLKn E40 1A VREFB1AN0 PLL_L1_CLKp PLL_L1_CLKp E39 1A VREFB1AN0 IO PLL_L1_CLKOUT0n DIFFIO_TX_L1n DIFFOUT_L1n G34 1A VREFB1AN0 IO PLL_L1_FB_CLKOUT0p DIFFIO_TX_L1p DIFFOUT_L1p H34 1A VREFB1AN0 IO RDN1A DIFFIO_RX_L1n DIFFOUT_L2n E37 1A VREFB1AN0 IO RUP1A DIFFIO_RX_L1p DIFFOUT_L2p F37 1A VREFB1AN0 IO DIFFIO_TX_L2n DIFFOUT_L3n M33 DQ1L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_TX_L2p DIFFOUT_L3p N33 DQ1L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L2n DIFFOUT_L4n J34 DQSn1L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L2p DIFFOUT_L4p K34 DQS1L DQ1L/CQn1L DQ1L 1A VREFB1AN0 IO DIFFIO_TX_L3n DIFFOUT_L5n R31 DQ1L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_TX_L3p DIFFOUT_L5p T31 DQ1L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L3n DIFFOUT_L6n J35 DQSn2L DQSn1L/DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L3p DIFFOUT_L6p K35 DQS2L DQS1L/CQ1L DQ1L/CQn1L 1A VREFB1AN0 IO DIFFIO_TX_L4n DIFFOUT_L7n P31 DQ2L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_TX_L4p DIFFOUT_L7p R30 DQ2L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L4n DIFFOUT_L8n H36 DQ2L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L4p DIFFOUT_L8p J36 DQ2L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_TX_L5n DIFFOUT_L9n M35 DQ3L DQ2L DQ1L 1A VREFB1AN0 IO DIFFIO_TX_L5p DIFFOUT_L9p N35 DQ3L DQ2L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L5n DIFFOUT_L10n E38 DQSn3L DQ2L DQSn1L/DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L5p DIFFOUT_L10p F38 DQS3L DQ2L/CQn2L DQS1L/CQ1L 1A VREFB1AN0 IO DIFFIO_TX_L6n DIFFOUT_L11n L36 DQ3L DQ2L DQ1L 1A VREFB1AN0 IO DIFFIO_TX_L6p DIFFOUT_L11p M36 DQ3L DQ2L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L6n DIFFOUT_L12n G37 DQSn4L DQSn2L/DQ2L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L6p DIFFOUT_L12p H37 DQS4L DQS2L/CQ2L DQ1L 1A VREFB1AN0 IO DIFFIO_TX_L7n DIFFOUT_L13n T30 DQ4L DQ2L DQ1L 1A VREFB1AN0 IO DIFFIO_TX_L7p DIFFOUT_L13p U30 DQ4L DQ2L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L7n DIFFOUT_L14n J37 DQ4L DQ2L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L7p DIFFOUT_L14p K37 DQ4L DQ2L DQ1L 1A VREFB1AN0 IO DIFFIO_TX_L8n DIFFOUT_L15n W31 DQ5L DQ3L 1A VREFB1AN0 IO DIFFIO_TX_L8p DIFFOUT_L15p W30 DQ5L DQ3L 1A VREFB1AN0 IO DIFFIO_RX_L8n DIFFOUT_L16n H40 DQSn5L DQ3L 1A VREFB1AN0 IO DIFFIO_RX_L8p DIFFOUT_L16p J40 DQS5L DQ3L/CQn3L 1A VREFB1AN0 IO DIFFIO_TX_L9n DIFFOUT_L17n L35 DQ5L DQ3L 1A VREFB1AN0 IO DIFFIO_TX_L9p DIFFOUT_L17p L34 DQ5L DQ3L 1A VREFB1AN0 IO DIFFIO_RX_L9n DIFFOUT_L18n F40 DQSn6L DQSn3L/DQ3L 1A VREFB1AN0 IO DIFFIO_RX_L9p DIFFOUT_L18p F39 DQS6L DQS3L/CQ3L 1A VREFB1AN0 IO DIFFIO_TX_L10n DIFFOUT_L19n N34 DQ6L DQ3L 1A VREFB1AN0 IO DIFFIO_TX_L10p DIFFOUT_L19p P34 DQ6L DQ3L 1A VREFB1AN0 IO DIFFIO_RX_L10n DIFFOUT_L20n H38 DQ6L DQ3L 1A VREFB1AN0 IO DIFFIO_RX_L10p DIFFOUT_L20p J38 DQ6L DQ3L 1A VREFB1AN0 IO DIFFIO_TX_L11n DIFFOUT_L21n V31 DQ7L 1A VREFB1AN0 IO DIFFIO_TX_L11p DIFFOUT_L21p V30 DQ7L 1A VREFB1AN0 IO DIFFIO_RX_L11n DIFFOUT_L22n G40 DQSn7L 1A VREFB1AN0 IO DIFFIO_RX_L11p DIFFOUT_L22p G39 DQS7L 1A VREFB1AN0 IO DIFFIO_TX_L12n DIFFOUT_L23n R33 DQ7L 1A VREFB1AN0 IO DIFFIO_TX_L12p DIFFOUT_L23p P32 DQ7L 1A VREFB1AN0 IO DIFFIO_RX_L12n DIFFOUT_L24n J39 1A VREFB1AN0 IO DIFFIO_RX_L12p DIFFOUT_L24p K39 1C VREFB1CN0 IO DIFFIO_TX_L19n DIFFOUT_L37n P36 DQ12L DQ12L DQ12L 1C VREFB1CN0 IO DIFFIO_TX_L19p DIFFOUT_L37p P35 DQ12L DQ12L DQ12L 1C VREFB1CN0 IO DIFFIO_RX_L19n DIFFOUT_L38n M38 DQSn12L DQ12L DQ12L 1C VREFB1CN0 IO DIFFIO_RX_L19p DIFFOUT_L38p M37 DQS12L DQ12L/CQn12L DQ12L 1C VREFB1CN0 IO DIFFIO_TX_L20n DIFFOUT_L39n U32 DQ12L DQ12L DQ12L 1C VREFB1CN0 IO DIFFIO_TX_L20p DIFFOUT_L39p V32 DQ12L DQ12L DQ12L 1C VREFB1CN0 IO DIFFIO_RX_L20n DIFFOUT_L40n L39 DQSn13L DQSn12L/DQ12L DQ12L 1C VREFB1CN0 IO DIFFIO_RX_L20p DIFFOUT_L40p L38 DQS13L DQS12L/CQ12L DQ12L/CQn12L 1C VREFB1CN0 IO DIFFIO_TX_L21n DIFFOUT_L41n T33 DQ13L DQ12L DQ12L 1C VREFB1CN0 IO DIFFIO_TX_L21p DIFFOUT_L41p U33 DQ13L DQ12L DQ12L 1C VREFB1CN0 IO DIFFIO_RX_L21n DIFFOUT_L42n M40 DQ13L DQ12L DQ12L 1C VREFB1CN0 IO DIFFIO_RX_L21p DIFFOUT_L42p M39 DQ13L DQ12L DQ12L 1C VREFB1CN0 IO DIFFIO_TX_L22n DIFFOUT_L43n V34 DQ14L DQ13L DQ12L 1C VREFB1CN0 IO DIFFIO_TX_L22p DIFFOUT_L43p W33 DQ14L DQ13L DQ12L 1C VREFB1CN0 IO DIFFIO_RX_L22n DIFFOUT_L44n K40 DQSn14L DQ13L DQSn12L/DQ12L 1C VREFB1CN0 IO DIFFIO_RX_L22p DIFFOUT_L44p L40 DQS14L DQ13L/CQn13L DQS12L/CQ12L 1C VREFB1CN0 IO DIFFIO_TX_L23n DIFFOUT_L45n U36 DQ14L DQ13L DQ12L 1C VREFB1CN0 IO DIFFIO_TX_L23p DIFFOUT_L45p V35 DQ14L DQ13L DQ12L 1C VREFB1CN0 IO DIFFIO_RX_L23n DIFFOUT_L46n R38 DQSn15L DQSn13L/DQ13L DQ12L 1C VREFB1CN0 IO DIFFIO_RX_L23p DIFFOUT_L46p R37 DQS15L DQS13L/CQ13L DQ12L 1C VREFB1CN0 IO CLKUSR DIFFIO_TX_L24n DIFFOUT_L47n V37 DQ15L DQ13L DQ12L 1C VREFB1CN0 IO DIFFIO_TX_L24p DIFFOUT_L47p V36 DQ15L DQ13L DQ12L 1C VREFB1CN0 IO DIFFIO_RX_L24n DIFFOUT_L48n N40 DQ15L DQ13L DQ12L 1C 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