Stratix® 10 HyperFlex™ アーキテクチャの概要 (Japanese Version of Stratix® 10 HyperFlex™ Architecture Overview) (OJS10ARCH)

26 Minutes Online Course

Course Description

「Stratix® 10 HyperFlex™ アーキテクチャーの概要」のオンライン・トレーニングでは、インテル® Stratix® 10デバイスに新たに搭載された革新的なHyperFlex™ アーキテクチャーについて学習します。従来型のFPGAアーキテクチャーと比較した場合、HyperFlex™ アーキテクチャーは、最大2倍のスピードでデザインを実行することが可能です。また、HyperFlex™ アーキテクチャーの基本的なビルディング・ブロックである Hyper-Registerについても学習し、Hyper-Registerを活用するための3つのデザイン・テクニックであるHyper-Retiming、Hyper-PipeliningおよびHyper-Optimizationについてのおおまかな知識を得ることができます。

At Course Completion

You will be able to:

  • Hyper-Registerおよびプログラマブル・クロック・ツリー・シンセシスを含む、インテル® Stratix® 10 HyperFlex™ アーキテクチャーについての理解
  • Stratix 10® デバイスのデザイン性能を2倍以上向上させるための3つのテクニックであるHyper-Retiming、Hyper-PipeliningおよびHyper-Optimizationの定義

Skills Required

  • FPGA/CPLDデザインフローの使用経験がある方
  • FPGAアーキテクチャーの知識をお持ちの方

Applicable Training Curriculum

This course is part of the following Intel FPGA training curriculum:

Class Schedule

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